SIMULADOR DE UCP COM SUPORTE À MEMÓRIA CACHE E PIPELINE

Autores

Artur Jordão Lima Correia
Mario Augusto Pazoti UNOESTE
Francisco Assis da Silva FIPP/UNOESTE
Leandro Luiz de Almeida UNOESTE
Danillo Roberto Pereira Unoeste

Palavras-chave:

Simulador UCP, Cache, Pipeline

Resumo

Um problema comum em disciplinas de arquitetura de computadores é a dinâmica real dos processos que ocorrem internamente em hardware. O funcionamento de uma UCP, por exemplo, é algo complexo e sua compreensão é fundamental para utilização de seus recursos. Este trabalho contribui com o desenvolvimento de um simulador de UCP com suporte à memória cache e pipeline. São apresentados os resultados obtidos com a ferramenta desenvolvida, e que a utilização do simulador pode ser muito útil como apoio em disciplinas de arquitetura de computadores, melhorando o entendimento por parte dos alunos.

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Biografia do Autor

Francisco Assis da Silva, FIPP/UNOESTE

Possui graduação em Bacharelado em Ciência da Computação pela Universidade do Oeste Paulista (1998), mestrado em Computação pela Universidade Federal do Rio Grande do Sul (2002) e doutorado em Ciências, programa de Engenharia Elétrica pela Universidade de São Paulo (2012). Atualmente é professor titular da Universidade do Oeste Paulista.

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Publicado

2015-01-26

Edição

v. 6 n. 3 (2014): Colloquium Exactarum

Seção

Artigo Científico Original

Como Citar

SIMULADOR DE UCP COM SUPORTE À MEMÓRIA CACHE E PIPELINE. (2015). Colloquium Exactarum. ISSN: 2178-8332, 6(3), 10-25. https://journal.unoeste.br/index.php/ce/article/view/1096

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